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Inno反激電源GND設(shè)計

在實際工程應(yīng)用原理設(shè)計時,往往會分很多的地,比如輸入電源地、內(nèi)部電源地、功率地、模擬地、邏輯地、數(shù)字地、機殼地等。

功率地:一般指流過大電流部分電路的地,比如大功率三極管、MOS管主回路的地等;

模擬地:指模擬電路部分的地;

數(shù)字地:指邏輯電路、數(shù)字電路部分的地。

有些人會問既然是等電位,為什么要分這么多地呢?一個地設(shè)計起來不是更方便?

將它們分開,通過磁珠、電感或零歐姆電阻單點接觸,可以防止設(shè)計印制板時不同的地之間相互串擾,減少電磁干擾,比如數(shù)字地和模擬器之間只通過磁珠單點相連,可以有效地把數(shù)字地和模擬地分為兩部分,印制板上較好地分割布局,防止不同功能模塊電路之間干擾;

PI反激電源在地線的處理上都需特別注意,如下圖所示,Layout時輔助繞組地、IC信號地功率地在bulk電容處匯合,避免IC地受干擾導(dǎo)致驅(qū)動振蕩。

Layout上還需注意:

第一,如果存在電流檢測電阻,此種場合GaN的開爾文腳與源極直接連接,否則電流采樣電阻失去作用。

第二,Source端與bulk電容地的走線盡可能短、粗,減小寄生電感Ls。驅(qū)動電路和功率電路分開布置,避免干擾。

第三,驅(qū)動IC及驅(qū)動電路盡量靠近GaN一些,減小驅(qū)動回路的走線和面積。

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only one
LV.8
2
06-21 23:43

第一,如果存在電流檢測電阻,此種場合GaN的開爾文腳與源極直接連接,否則電流采樣電阻失去作用,為什么?

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06-22 23:15

PI反激電源在地線的處理上都需特別注意,如下圖所示,Layout時輔助繞組地、IC信號地功率地在bulk電容處匯合,避免IC地受干擾導(dǎo)致驅(qū)動振蕩。走線很重要

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沈夜
LV.8
4
06-22 23:52

地線分離設(shè)計有何優(yōu)勢?

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tanb006
LV.10
5
06-23 14:26

這樣的設(shè)計是幾乎完美的。但實際上有很多因素困擾。比如老板讓用單面板、散熱片和其他零件位置沖突,奇奇怪怪的要求總會使接至電容的地線增長。而在細的地線上鍍錫又會增加成本。

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tanb006
LV.10
6
06-23 14:27
@only one
第一,如果存在電流檢測電阻,此種場合GaN的開爾文腳與源極直接連接,否則電流采樣電阻失去作用,為什么?

采樣電阻建議用運放做一級差分放大再輸出到芯片。這樣就沒有地線干擾的問題了。

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06-24 23:22

電源接地也這么深么

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tanb006
LV.10
8
06-25 15:02

用磁珠連接不同的地是個好方法。磁珠也不貴,自從我看到這個帖子之后就試了下,電源之前有環(huán)路異響,用了磁珠隔離之后就完全正常了。真不錯的帖子。

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htwdb
LV.8
9
06-25 20:45

對于電源輸入電容負極、變壓器輔助繞組地、芯片GND引腳的最佳連接點如何選擇?

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dy-TMelSvc9
LV.8
10
06-25 21:52

反激電源的信號傳輸有哪些規(guī)律

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XHH9062
LV.9
11
06-25 23:02

感謝分享

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dy-StTIVH1p
LV.8
12
06-25 23:14

接地過程中怎么樣確保信號傳輸損失過大

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dy-StTIVH1p
LV.8
13
06-26 09:28

GND設(shè)計有利于降低系統(tǒng)傳導(dǎo)的能量損耗

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fzwwj95
LV.6
14
06-26 09:52

在反激電源設(shè)計中,電源輸入電容負極、變壓器輔助繞組地和芯片GND引腳的最佳連接點應(yīng)選擇在bulk電容的負極處。這是因為bulk電容作為主濾波電容,其負極提供低阻抗路徑,能有效減少地回路噪聲和電磁干擾。通過單點星形連接,可以避免地線環(huán)路問題,防止驅(qū)動振蕩。同時,確保連接線短而粗,以最小化寄生電感,提升系統(tǒng)穩(wěn)定性。

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dy-mb2U9pBf
LV.8
15
07-03 21:25

有很多地,怎么設(shè)計和規(guī)劃是門學(xué)問,這個需要系統(tǒng)地學(xué)習(xí)和應(yīng)用。

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方笑塵MK
LV.8
16
07-15 21:07

接地時注意多個輸出電容并聯(lián)時,保證負端銅箔等長等寬(對稱“T”或“Y”形),避免不均流

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linghz
LV.5
17
08-22 16:32

輸入濾波電容與IC源極引腳的銅箔區(qū)域應(yīng)作為功率地匯合點,避免形成地環(huán)路噪聲‌。

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08-23 21:47

若模擬地與數(shù)字地直接相連,這種高頻噪聲會耦合到模擬電路(如運算放大器、ADC),導(dǎo)致模擬信號失真,比如 ADC 采樣精度從 12 位降至 8 位。

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dy-nmLUWFNr
LV.8
19
08-24 12:15

反激電源的接地設(shè)計有哪些注意事項

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